随着电子产品速度的提升，信号完整性变得越来越重要，产品零件的选择， PCB Layout 的结构走线等因素都会对其造成影响。它主要研究了互联机与信号电 压电流波形相互作用时其电气特性参数如何影响产品性能。

基于以上传输线信号完整性问题，启威测信号完整性实验中心根据客户需求创建以下信号完整性量测能力：

1.USB接口 

2.网络接口 

3.显示接口(HDMI/DVI/Display Port/VGA)

4.存储类总线(DDR/EMMC/NOR Flash/NAND Flash)

5.传输类总线(PCIe/SATA/MIPI/LVDS)

6.低速总线LPC/COM/PS2/I2C/SMBUS/UART

7.其他信号Power Ripple-Noise/Power Sequence/System Clock/RST/PWROK

8.TDR/NA 

9.电源完整性-PI（Power Integrity）

信号完整性仿真分析意义：

信号完整性仿真重点分析有关高速信号的3个主要问题：信号质量、串扰和时序。

对于信号质量，目标是获取具有明确的边缘，且没有过度过冲和下冲的信号。

通常，可以通过添加某种类型的端接以使驱动器的阻抗与传输线的阻抗相匹配来解决这些问题。对于多点分支总线，并非总能匹配阻抗，因此，需要将端接和拓扑的长度变化相合控制反射，使得它们不会对信号质量和时序产生不利影响。

电路板时序是系统时序的一个重要组成部分，并受线路长度、其在经过电路板时的传播速度以及接收器中波形形状的影响。由于波形的形状确定了接收的信号穿越逻辑阈值的时间，因此，它对于时序来说是非常重要的。这些仿真通常会驱动走线长度约束的变化。
   通常运行的另一个信号完整性仿真是串扰。这涉及多条相互耦合的传输线。随着走线挤进密集的电路板设计，了解它们正在相互耦合多少能量对于消除因串扰产生的错误是非常重要的。这些仿真将推动走线之间的Zui小间距要求。

更多关于信号完整性测试，请联系：

Helen  尹海英

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